反对 @昌维 的高赞答。
x86的兼容性负担是很重没错,但这并非ARM省电的原因。
如果生产工艺相同,频率相同的两个CPU,功耗的由参与计算的晶体管数量决定。
今天的CPU,以Intel的Skylake架构为例,单个核心(不含LLC)晶体管数量大概在150M左右,而x86的几个里程碑产品,晶体管数量分别是: 8086:29K[1]80386:275K[2]P5:3.1M-4.5M(P55C)[3]所谓的兼容性负担,也就是早期使用现在几乎不用的指令,基本是P5之前已经出现,而且386之…。
反对 @昌维 的高赞答。
x86的兼容性负担是很重没错,但这并非ARM省电的原因。
如果生产工艺相同,频率相同的两个CPU,功耗的由参与计算的晶体管数量决定。
今天的CPU,以Intel的Skylake架构为例,单个核心(不含LLC)晶体管数量大概在150M左右,而x86的几个里程碑产品,晶体管数量分别是: 8086:29K[1]80386:275K[2]P5:3.1M-4.5M(P55C)[3]所谓的兼容性负担,也就是早期使用现在几乎不用的指令,基本是P5之前已经出现,而且386之…。
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